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Verilog中#能被综合么,综合后有什么含义么?
来源:学生作业帮 编辑:
作业帮
分类:
综合作业
时间:2024/05/14 05:55:06
Verilog中#能被综合么,综合后有什么含义么?
always@(posedge clk or negedge nReset)
if nReset)
begin
RESETn
还有ud_cnt #(SIZE,ID) cnt (.clk(clk),....
不能综合,被忽略 了.
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