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verilog test fixture是什么文件

来源:学生作业帮 编辑:作业帮 分类:综合作业 时间:2024/05/11 15:16:49
verilog test fixture是什么文件
仿真文件,编写testbench
再问: ISE软件中,新建里有VHDL test bench,是波形文件吗,用verilog和VHDL语言编写的程序是用同一类波形文件吗?是哪个?
再答: 如果你用verilog,就新建verilog test fixture,如果用VHDL,就用VHDL test bench,我只用过verilog test fixture,新建了之后,再在里面编辑